메모리 시스템에 대한 정책에 대한 기본적인 질문이 있습니다.L2 퇴거시 L1 캐시에서 캐시 퇴거
개인 L1 및 L2 캐시가있는 코어를 생각해보십시오. L2 캐시 이후에는 일관성 트래픽이 실행되는 버스가 있습니다. 이제 주소 (X)에 대한 캐시 라인이 L2 캐시에서 제거되면 L1 캐시에서 해당 주소를 제거해야합니까 ??
퇴거의 이유는 일관성 프로토콜의 불변성을 유지하는 데 도움이 될 수 있습니다 [l2의 행에 잘못된이 코어가이 주소를 포함하지 않는다고 표시하는 경우].
줄 크기와 관련하여 의심의 여지가 있습니다. u는 동일한 http://stackoverflow.com/questions/14707803/line-size-of-l1-and-l2-caches를 명확히하십시오. –
다음과 같은 추가 정보를 제공해주십시오 : "포괄적 인 디자인이 더 빠르게 코어 간 동기화가 약간 더 큰 유효 캐시 크기를 갖는 것보다 중요 해지고 있습니다. " – rkioji