fixed-point

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    부동 소수점을 Q31 고정 소수점으로 변환해야하며, Q31은 1 부호 비트를 의미하고 정수 부분은 0 비트이고 소수 부분은 31 비트로 변환해야합니다. 즉, Q31은 [-1,0.9999] 범위의 숫자 만 나타낼 수 있습니다. 정의에 은 고정 소수점 플로트 변환 할 때, 2ˇN 의한 승산은, 난이 코드와 혼동있어 31 그러나,이 경우, N은 소수 부분의 크기

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    내가 공식에 대한 고정 소수점 값을 계산해야합니다 e^(Konst/x*y) 내가 제 3 자에게 divide() 및 antilog() 기능과 같이 사용 div = divide(Konst, x*y); out = antilog(div); 내 divide() 출력 에 제공 bits 23…0 fractional part (실제로는 Q0.31 시프트시 << 8)

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    제 3 자 고정 소수점 antilog() 함수를 사용하여 데시벨 out_mag = 10^(in_db/20)의 크기를 계산합니다. antilog()은 Q6.25 형식을 입력으로 사용하며 출력시 Q16.15을 제공합니다. 문제는 012 dB이 100 dB : 10^(100/20) = 100000처럼 더 높은 dB의 valus에서 빠르게 오버플로된다는 것입니다.

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    고정 소수점 코드 (즉, 16 비트 및 32 비트 정수)를 사용하고 있습니다. 이제 두 정수의 지수를 비교할 필요가 있습니다. int result = 705/239; int result2 = 720/235; 정수 만 사용하면 어떤 결과가 더 커지는 것을 알 수 있습니까? 수레를 사용하는 것은 당연히 여기에서 더 쉽지만 가능하지는 않습니다. 감사합니다.

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    부동 소수점 숫자를 fixed point integerQ16.16int (number * 0x10000)으로 인코딩 할 때 정밀도를 잃지 않고 표현할 수있는 부동 소수점 범위는 무엇입니까?

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    파이썬에서 숫자의 이진 표현을 얻는 방법이 있습니까? 음수를 나타낼 수 있어야합니다. 난 numpy에서 이미 기능을 시도했지만 np.binary_repr(Decimal(-1)) 오류가 발생합니다. 정확히 말하면 - 고정 소수점 수 (양수 및 음수)의 이진 표현을 어떻게 든 가져와서 Verilog 코드에 넣을 수 있습니다. 숫자가 1,5 인 경우를 예로 들어

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    저는 고정 소수점 산술, 특히 나눗셈 연산에 관심이 있습니다. 그러나 많은 사이트에서 2 진수 나누기, 즉 비트 교대 만 사용하는 방법을 설명합니다. 분모가 2의 거듭 제곱이 아니면 어떻게됩니까? 예를 들어 부호없는 16 비트 산술 연산에서 1/3을 어떻게 계산할 수 있습니까? 4-right 비트가 소수 부분이라고 가정합니다. 1 0000 0000 0001

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    분할 연산 (/)은 FPGA의 경우 비용이 많이 드나요? 기본 이동 작업으로 Q15 형식 번호 2 개 (16 비트 고정 소수점 수)를 나눌 수 있습니까? 누군가가 나를 도와 줄 수 있습니까? 미리 감사드립니다.

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    한 고정 소수점 표현에서 다른 고정 소수점 표현으로 숫자를 변환하려고합니다. 나는 2의 보수 표현 (Qmf 표현)을 사용하고있다. 이것은 하드웨어 구현을 검증하기위한 것이다. 하드웨어 구현은 다음과 같이 작동합니다. 입력 데이터는 Qmf 형식입니다. 입력 데이터의 폭은 8 비트이며 6 비트의 길이가 있습니다. 4 소수 비트 (정수 비트 없음) 4 비트 숫자

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    사인파를 추적하는 선형 칼만 필터의 여러 구현을 구현했습니다. 파이썬과 C가 모두 구현되어 있습니다. 그러나 고정 점 구현을 사용하는 버전도 개발했지만 작동하지만 처음에는 다른 칼만 필터 코드의 출력에서 ​​벗어난 이상한 효과가 나타납니다. 사람이 고정 소수점 구현에 잘못 갈 수있는 무엇에 대한 몇 가지 직관이 있는지 궁금 : 아래의 그래프를 참조하십시오?