neon

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    Cortex-A8 프로세서의 Windows Embedded Compact 7 ARM 어셈블러와 함께 ARM 웹 사이트의 NEON memory copy with preload 구현을 사용하고 있습니다. ; NEON memory copy with preload ALIGN LEAF_ENTRY NEONCopyPLD PLD [r1, #0xC0]

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    현재 vDSP 프레임 워크의 일부 기능, 특히 vDSP_conv를 사용하고 있는데 함수가 스칼라 모드를 호출하는지 SIMD에서 처리되는지 확인하는 방법이 있는지 궁금합니다. 네온 프로세서에. 기능의 documentation에는 충족되어야하는 power-pc-architecture에 대한 몇 가지 기준 또는 스칼라 모드가 호출됩니다. 지금 나는이 기준이 ip

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    ARM Neon VLD1 명령어의 정렬에 대해 질문이 있습니다. 다음 코드의 정렬은 어떻게 작동합니까? DATA .req r0 vld1.16 {d16, d17, d18, d19}, [DATA, :128]! 이의 시작 어드레스 데이터보다 더 적은 없다는 16의 최소 배수 (16 바이트 = 128 비트)가되도록 DATA + 양의 정수로 지시 교대

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    NEON 확장 레지스터는 16 개의 쿼드 워드 또는 32 개의 더블 워드로 볼 수 있습니다. 대부분의 프로그래밍에서 사용되는 특정 레지스터는 고정되어 있습니다. 예를 들어, vmov.i8 d0, 0xff vmov.i8 d1, 0xee vmov.i8 d2, 0xdd 내 문제는 필요한 더블 워드 레지스터의 수는 함수 호출의 인수에 따라 다릅니다. 인수가

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    NEON 기반 SIMD를 코드에 적용하는 중입니다. 그것은 밖으로 SIMDization 완벽하게 잘 작동하지만, 충돌을 일으키는 원인이되는 메이크 파일에 다음 한 줄, ifeq ($(TARGET_ARCH_ABI),armeabi-v7a) LOCAL_ARM_NEON := true endif 사람이 바로 코드가 절대적으로 같은 나머지와 NEON을

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    NEON의 12 개의 쿼드 레지스터를로드하는 간단한 asm 코드가 있으며, 이중 명령어 기능을 사용하기 위해로드 명령어와 함께 pairwise add 명령어를 병행했습니다. 여기 코드를 확인했습니다 하나는 볼 수 있듯이 http://pulsar.webshaker.net/ccc/sample-d3a7fe78 이 코드는 약 13주기를하고있다. 그러나 보드에 코드

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    벡터 데이터를 살펴보고 요소를 가장 가까운 범위에 따라 미리 정의 된 "히스토그램"버킷에 넣는 기능과 같은 히스토그램을 작성 중입니다. 분명히 조건을 사용하여이 작업을 수행 할 수 있지만 이미지 버퍼이므로 NEON을 사용하여이 작업을 향상 시키려고합니다. 이 작업을 수행하는 한 가지 방법은 VCEQ에서 VBIT를 사용하는 것이지만 슬프게도 네온의 헤더에서

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    8x8 데이터가 있습니다. 처리가 끝나면, 결과적으로 8x8 데이터를 계속 유지하면서 프로세스를 진행하고 있습니다. 내 질문은 루프에 의해 그들을 저장하는 4 Q- 레지스터를 프로그래밍하는 것이 가능한 경우입니다. 그러나 컴파일되지 않습니다 다음 코드는 또한 mov r4, #7 1: . . vmul.i16 d12, d12, d1[r4] subs

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    Cortex A15에서와 같이 NEON SIMD 버전 2와 NEON SIMD 버전 2의 차이점은 무엇입니까?

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    pandaboard에 임베드 된 Qt (OMAP4, 4430)를 컴파일하려고합니다. 내가 지난 QT-포함 된 소스를 다운로드하여 폴더에 uncopressed sudo apt-get install g++-4.6-arm-linux-gnueabihf : /opt/qt-everywhere-opensource-src-4.6.4 내가하는 ARMv7이 크로스 컴파일