processor

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    Rescheduling interrupts (RES) 란 무엇입니까? 그 원인은 무엇입니까? Linux 커널에서 어떻게 처리됩니까?

    "RES : Rescheduling interrupts"와 "LOC : Local timer interrupts"의 차이점은 무엇입니까? RES 인터럽트를 발생시키는 것은 무엇입니까? LOC는 프로세서의 Timer h/w에 의해 생성되는 일반 타이머 인터럽트와 동일합니까? 또한 타이머 인터럽트 및 RES 인터럽트 중에 스케줄러의 어떤 부분이 호출되는지 명확
    timer linux-kernel interrupt scheduler processor 2013-08-23

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    여러 드라이버가있는 Verilog에서 BUS를 처리하는 방법

    크기 16 비트의 공통 "BUS"를 공유하는 여러 모듈을 Verilog에 연결하려고합니다. 여러 입력 (드라이버)을 버스에 연결하는 데 문제가 있습니다. 하나 이상의 드라이버를 연결하면 Xilinx에서 오류가 발생합니다. 단위 신호 BUS {Top_Module_Name}은 다음 여러 드라이버에 접속된다 I는이 코드 모듈은 상부 모듈 input en;
    verilog processor xilinx bus 2013-12-15

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    MESI 프로토콜 - INVALID를 처리하는 방법은 무엇입니까?

    두 가지 수준의 캐시 (쓰기)가있는 샘플 MESI 캐시 시뮬레이터를 구현하려고합니다. 캐시의 두 레벨에 MESI 상태 비트를 추가했습니다. 후기 입 캐시이므로 캐시 라인은 플러시 될 때만 L2로 업데이트됩니다. 내 의심은 입니다. INVALID 상태의 캐시 라인이 L1 캐시에서 플러시 될 때의 동작은 무엇이되어야합니다. 거래를 그냥 무시합니까? 그것은 유일
    java multithreading caching processor bus 2013-12-17

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    Verilog 양방향 핸드 셰이 킹 예

    프로젝트를 마무리하고 있으며 프로세서 내부의 기능 유닛간에 양방향 핸드 쉐이킹이 필요합니다. 나는 그것이 무엇인지는 알지만 어떤 '표준'이나 좋은 간단한 예가 있는가? 두 유닛간에 데이터 라인이 있고 X가 Y로 보낼 때 별도의 '보낸'신호가 주어집니다. Y가 '수신'신호를 받으면 다른 와이어의 X로 신호가 전송됩니다. X가 수신 된 신호를 읽으면 데이터 라
    verilog processor computer-architecture 2013-12-17

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    EPT 더티/액세스 비트를 지원하는 인텔 프로세서를 찾을 수있는 곳

    EPT 더티/액세스 비트를 지원하는 인텔 프로세서를 찾고 있는데 지금까지 찾을 수 없습니다. 나는 인텔 맞춤 서비스를 불렀는데 분명히 사람들은 EPT 더티/액세스 비트가 무엇인지 전혀 몰랐습니다. 필자는 EPT 더티/액세스 비트를 지원하는 제출 된 패치 작성자에게도 쓴 적이 있지만 작성자가 아직 응답하지 않았습니다. 누구든지 알고 계시면 알려주세요. 미리
    virtualization intel processor 2013-11-03

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    QEMU에서 싱글 스텝 모드를 사용하는 방법은 무엇입니까?

    필자는 qemu를 처음 접했고 독서 모드 에뮬레이션을 허용한다는 내용을 읽었습니다. 이것은 매주기마다 물리적 램의 일부 주소를 덤프하려고하기 때문에 유용합니다. 불행히도, qemu 문서는 매우 나쁩니다. qemu 모니터에서 단일 단계 모드를 활성화하는 방법을 알고 있지만 모든 단계에서 실행하려는 코드를 어디에 넣어야할지 모릅니다. 누구든지 이것에 대한 정보
    processor qemu kvm emulation 2013-11-04

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    가장 널리 사용되는 컴퓨터 아키텍처에서 곱셈과 나눗셈 O (1)이 구현되는 방식입니까?

    널리 사용되는 컴퓨터 아키텍처에서 곱셈과 나눗셈 O (1)이 구현되는 방식은 무엇입니까? x86 및 ARM의 경우 곱셈과 나눗셈 O (1)입니까? Java의 BigInteger 클래스를 사용하고 BigInteger의 두 인스턴스를 곱하거나 나누면 어떻게 될까요? 이것은 분명히 O (1)가 아닐 수도 있지만 복잡성은 무엇입니까?
    java algorithm architecture processor 2013-09-22

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    샌디 브리지/제온 프로세서가 아닌 RAPL과 비슷한 것

    첫 번째 게시물은 여기에 있습니다. 실험실에서 컴퓨터가 작동 중일 때 Sandy Bridge 또는 Xeon 프로세서가 아닌 다른 프로세서 (Intel i7)의 Running Average Power Limit와 유사한 것이 있는지 알고 싶었습니다. 모르는 분들. 나는이 설명을 풀어 속도를 높였다. 는 "RAPL는 (실행 평균 전력 제한) 인터페이스, 모니터
    linux cpu intel processor energy 2013-09-29

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    Linux에서 세마포어를 사용하여 CPU를 차단할 수 있습니까? (파이썬)

    제한된 자원의 사용을 세마포어로 제한 할 수 있다는 것을 알고 있지만, CPU (또는 커널, 그렇게하는 것이 현명한 경우)에 어떻게 적용 할 수 있습니까? 단일 프로세서에서 여러 스레드가 동시에 실행됩니다. 그러나 스레드 중 하나에서 신호를 보내고 신호가 다시 오는데 걸리는 시간을 필요로하는 코드 조각을 실행하고 싶습니다. 신호는 매우 왜곡 된 것처럼 보이
    python linux cpu semaphore processor 2013-11-20

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    필요한 코어 및 RAM 수를 확인하는 방법?

    Apache Tomcat 7에서 실행되는 Spring Application을 보유하고 있으며 REST 기반 서비스를 완벽하게 제공합니다. 전 세계적으로 1 백만 명이 사용할 것입니다. 내 질문은 그곳에 필요한 프로세서의 수를 계산하는 표준 방법이 있다는 것입니다. 내가 가장 마음에 들었으므로 제품을 현명하게 주문하고 싶습니다. 나는 진지하게 내가 그러한 견
    java spring tomcat core processor 2013-08-19
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