alu

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    별도의 캐리 플래그와 빌로우 플래그로 간단한 애 더를 설계하는 방법은 무엇입니까?

    나는 간단한 가산기를 구현 중이다. 그러나, 나는 약간의 독특한 트위스트의 필요성이있다. 구현중인 것은 코드 세그먼트 (CS) 레지스터와 명령어 포인터 (IP) 레지스터에서 "롤오버"기능입니다. 따라서 상대 점프를 +20으로하고 IP가 254이면 IP는 18로 끝나고 CS는 1 씩 증가합니다. 이 부분은 쉽고, 어려운 부분은 반대입니다 방향. 점프가 -20
    vhdl alu 2012-05-07

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    x86 ALU의 캐리/보조 플래그 기능

    Verilog에서 8086 프로세서를 만들려고 노력하고 있으며, 아키텍처의 대부분을 평균 이상으로 잘 이해하고 있습니다. 포인트),하지만 ALU에서 캐리 플래그와 보조 플래그가 작동하는 방식에 대해 머리를 감싸는 것처럼 보일 수는 없습니다. 나는 CF가 결과가 ALU의 비트 폭보다 커지게하는 더하기 또는 빼기 (이 경우 Borrow라고 함)시 트리거된다는
    verilog status x86-16 alu 2013-08-02

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    테스트 벤치 다중 아키텍처

    죄송합니다.이 웹 사이트를 처음 사용하지만 거의 2 일 동안 답변을 검색했습니다. 저는 VHDL을 처음 사용하고 있으며, 간단한 16 비트 ALU를 지정하도록 과제가 지정되었습니다. 이 ALU에는 RTL 디자인뿐 아니라 행동 적 아키텍처도 2 가지 아키텍처가 필요합니다. 내가 원하는만큼 완전한 코드를 가지고있다. 내가 알 수없는 것은 내가 ModelSim의
    vhdl modelsim altera alu 2013-09-23

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    Z80 플래그 - 생성 방법은 무엇입니까?

    Z80 호환 프로젝트를 설계 중입니다. 나는 플래그 레지스터를 디자인 할 것이다. 원래 나는 플래그가 ALU 연산의 입력 및 유형에 따라 ALU에서 직접 생성되었다고 생각했습니다. 그러나 지침과 플래그 결과를 살펴본 후에는 플래그가 항상이 논리와 일치하지 않는 것으로 보입니다. 그 결과 나는 매번 정확한 플래그를 생성하기 위해 ALU에 연산 코드를 공급해야
    microcontroller flags opcode z80 alu 2012-07-17

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    스키마의 n 비트 ALU

    나는 스키마에서 n 비트 ALU를 만들고 있으며, 지금까지 1 비트 ALU를 가졌습니다. 누군가이 문제에 접근하는 방법을 말해 줄 수 있습니까? 여기에 대한 지시이다 : 'add, 'sub, 'and, 'or 또는 'xor :가 절차의 형식은 첫 번째 파라미터가 selection는 임의의 값을 취할 수 (ALUn selection x1 x2 n) 이다
    scheme racket alu 2012-04-09

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    ALU Verilog 테스트 벤치가 제대로 초기화되지 않았습니까?

    내 ALU 용 테스트 벤치를 작성하려하지만 임씨는 초보자 용입니다. 임씨는 그것이 작동하도록 작성된 것인지 확실하지 않습니다. 예를 들어 내가 dut 또는 uut을 사용해야합니까? 입력을 올바르게 초기화 했습니까? 출력 웨이브는 각 비트 X와 하나의 0으로 바뀌지 않습니다. 모든 통찰력은 크게 감사 할 것입니다. module Alu_test();
    testing verilog alu 2013-05-17

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    CUDA/OpenCL을 사용하여 특정 ALU에 명령/알고리즘을 할당합니까?

    저는 GPU 프로그래밍을 처음 접했습니다. 나는 기본적인 개념을 설명하는 자료를 읽었다. 그러나 특정 ALU에 일련의 명령어 또는 전체 알고리즘/바이너리를 할당 할 수 있는지 알고 싶습니다. 이러한 명령어가이 ALU에서만 실행되었다는 것을 확신 할 수 있습니다 (따라서 바이 패스 병렬 처리를 자동으로 처리하는 시스템)? 나는 그들 사이의 잠재적 인 컴퓨팅
    cuda opencl race-condition alu 2013-10-16

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    ALU에서 부호있는 정수와 부호없는 정수를 구별하는 가장 좋은 방법은 무엇입니까?

    나는 내 자신의 가상 4 비트 ALU를 개발하고있다. 나는 계산기 (+, -, *, /, %, 정수, 어쩌면 더 많은 비트)를 만들고 싶습니다. 나의 목표는 효율적인 장치를 만드는 것이 아니라 철저히 이해하는 것입니다. 추가 : 은 현재 내가 4 개 기능을 구현했습니다. 하나 추가 중. 음수에 양수입니다. 빼기. 모든 기능에서 결과의 5 번째 비트는 무시됩
    integer unsigned signed alu 2013-07-11

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    nbit를 들어/IF와 Bitslice ALU VHDL

    I 생성과 ALU bitslice nbit을 설계하고있어 에 생성하고이 코드 작성 : 비록이, library IEEE; use IEEE.std_logic_1164.all; use IEEE.numeric_std.all; ENTITY ALU IS GENERIC (n : integer := 8); PORT (A,B : IN std_lo
    if-statement for-loop vhdl alu 2013-10-24

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    ALU에 대해 몇 가지 질문이 있습니다.

    저는 지난 몇 개월 동안 컴퓨터에 대해 배우려고 노력했으며 실제로 어떻게 작동하는지 자세히 설명했습니다. 나는 최근에 감산기에 대해 배우고 있었고 궁금 해서요. 우선, 제 생각에 감산 기는 결과를 얻기 위해 2 개의 칭찬을 사용합니다. 그러나, 그것은 왜 뺄까요? 예를 들어, 2의 칭찬 인 5 (0101)는 1011입니다. 그러나 이것은 또한 긍정적 인 1
    logic alu 2013-07-24
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