fpga

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    VHDL-PWM 이상 동작 및 물리적 상한/하한

    VHDL (자일링스 ISE + ISim)의 스파르탄 3e 보드를 사용하여 피코 초 PWM 신호를 생성하려고합니다. library ieee; use ieee.std_logic_1164.all; entity pwm is port(clk : in std_logic; pwm_out : buffer std_logic); end enti
    vhdl fpga xilinx pwm 2013-07-09

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    VHDL 상태 머신의 출력 동기화되지

    이 일반적인 FPGA 설계 질문에, 나는 FPGA 설계에 새로운 종류의이야 그냥 멋진 선형 대수 해법을 구축, 내 첫 번째 대규모 프로젝트에 착수했다. 시스템은 꽤 큽니다. 그래서 처음부터 올바르게 시작하는 것이 중요합니다. 성공적인 시뮬레이션 후 내가 지금 sythensizing하고 있지만, 악몽 데, 나는 구축하고 시뮬레이션에서와 같이 아무것도 작동하지
    hardware vhdl fpga xilinx finite-state-machine 2013-07-23

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    Parallela FPGA-64 코어는 GPU 및 비싼 FPGA와 비교해 성능이 우수합니까?

    이것은 Parallela입니다 : http://anycpu.org/forum/viewtopic.php?f=13&t=66 그것은, 모든 사람들이 그것에 대해 외치고의 이더넷 리눅스, 실행 .... 내 질문은 성능에서, 64 개 코어 1 기가 바이트 RAM입니다했다/능력 관점 Parallela는 더 비싼 FPGA와 어떻게 비교됩니까? 그들은 더 넓은 버스/더
    performance architecture gpu vhdl fpga 2013-07-23

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    GHDL이 실행중인 테스트 벤치

    VHDL에서 간단한 게임 구현을 테스트 할 때 "테스트 끝"메시지를 인쇄 한 후 빈 테스트 벤치의 GHDL 시뮬레이션이 CPU 사용률이 100 %로 중단됩니다. ----- Package ------------------------------ library ieee; use ieee.std_logic_1164.all; package data_types
    vhdl fpga ghdl 2013-07-25

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    dma 드라이버 리눅스 모듈을 인스턴스화하고 사용하는 방법

    우리는 많은 데이터를 빠르게 처리하기 위해 자일링스 Zynq FPGA 사용자 정의 DMA 디바이스를 개발 중이다. 베어 메탈에서 모든 작업을 할 수 있었지만 Linux에서는 문제가 있습니다. ARM Linux 커널 3.9에서 작업합니다. 우리 디바이스의 커널 드라이버를 인스턴스화하고 사용하는 방법을 모르겠습니다. https://github.com/Xilin
    linux kernel driver fpga 2013-07-28

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    1D 또는 2D 부동 소수점 배열을 합성 가능 Verilog에서 입력 포트로 정의

    부동 소수점 인 일부 입력 및 출력 포트를 정의하여 실제 데이터 유형을 선택했지만 실제 검색 값에 따라 입력 값을 전달할 수는 없습니다 사용 가능한 변환은 합성 할 수 없습니다. input real [0:10] delta; parameter ndelta= 100; input real [0:10] ly; input real [0:10] nly; out
    verilog fpga xilinx 2013-07-31

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    FPGA와 GPU를 사용한 가속 PHP

    일부 FPGA 모듈 (자일링스)과 PHP가 포함 된 자체 서버가 있습니다. 서버는 가끔로드가 많으며 특히 PHP 스크립트는 서버를로드합니다. 우리는 GPU와 FPGA에서 PHP script exec의 일부를 시도하고자합니다. 당신은 어떻게 생각하십니까? 최적화하는 것이 현명한 방법입니까?
    php gpu fpga 2013-08-01

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    FPGA의 CPU 소프트 코어

    여기에 조언이 필요합니다. 내 중년 취미 프로젝트 중 하나는 FPGA 디바이스에서 인기있는 ISA (예 : ARM7)의 명령어 세트 에뮬레이터를 빌드하는 것입니다. 많은 사람들이 전에 이것을 해왔습니다. 내 요구 사항은 구체적입니다. 나는 SoC 레퍼런스 프로젝트와 온보드 주변 장치 지원을 갖춘 개발 플랫폼을 찾고있다. 아이디어는 CPU에만 초점을 맞추는
    cpu vhdl verilog fpga 2013-08-06

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    하드웨어에서 작은 정수를 나눌 때 어떤 분할 알고리즘을 사용해야합니까?

    0에서 1023까지의 정수를 곱하고 그 결과를 하드웨어 (verilog/fpga 구현)에서 1-1023 범위의 숫자로 나눌 필요가 있습니다. 곱셈은 ​​10 비트 이동으로 도망 갈 수 있기 때문에 직선적입니다. (필요한 경우 1023을 뺍니다). 부문은 약간 재미있다. Area/power are not는 나에게 정말로 중요하다. (나는 FPGA에있어 리소스
    algorithm verilog division fpga 2013-08-07

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    fpga를 사용하여 샘플을 가져 오는 방법은 무엇입니까?

    FPGA 스파르타 3에 외부로 전송되는 디지털 데이터의 샘플을 가져오고 싶습니다. 처음에 1000 샘플/초를 가져 가고 싶습니다. VHDL 코딩에서 클럭 주파수를 선택하는 방법? 감사합니다.
    vhdl fpga spartan 2013-08-08
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