fpga

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    VHDL 신호를 사용하여 온도 값을 유지

    신호 할당은 프로세스가 끝날 때 수행된다는 것을 알고 있습니다. 그러나 두 신호 "A"와 "B"가 있다고 가정 해 봅시다. A의 값은 (거의 매주기마다) 내 프로세스에서 자주 바뀌고 B는 A의 값을 임시 값으로 유지하여 다음 클럭 사이클에서 다른 신호에 할당합니다. 그러나 어떤 일이 발생하지 않으면 B의 가치가 바뀌길 원치 않습니다. 따라서 프로세스에서 A
    vhdl fpga 2016-12-21

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    Verilog testbench - 포함 된 파일에서 신호를 보내는 작업을 사용합니까?

    FPGA와 CPU를 사용하는 디자인을 시뮬레이션 중입니다. CPU는 SPI를 통해 FPGA와 통신하고, FPGA는 통신 된 데이터를 기반으로 일부 출력을 제어합니다. 시뮬레이션을 실행하고 시뮬레이트 된 CPU 테스트 벤치에서 SPI를 통해 FPGA 레지스터를 읽고 쓸 수 있습니다. 이제는 코드를 리팩터링하여 좀 더 깔끔하게 정리하고 싶습니다. 내가 테스트
    verilog simulation fpga 2016-12-22

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    mmap UIO 장치의 EINVAL 오류

    /dev/mem 대신 직접 UIO를 사용하려고 시도한 후에 Xilinx Zynq에서 실제 메모리를 매핑하는 데 문제가 있습니다. root 대신 일반 사용자로 응용 프로그램을 실행하는 것이 계획이지만 이는 여전히 root으로 실행됩니다. 분명히 첫 번째 매핑은 성공적이지만 동일한 파일 설명자 12 (/dev/uio/ps2pl)에 대한 나머지 작업은 실패합니다
    fpga xilinx device-tree zynq 2016-12-24

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    에뮬레이트 알터 비트 스트림

    소프트웨어에서 에뮬레이트하고 싶은 컴파일 된 (바이너리) 비트 스트림 파일이 있습니다. Linux, Mac, Windows .. 뭐든지갑니다. 아마 시간이 오래 걸리 겠지만 시간이 얼마나 걸릴지는 신경 쓰지 않습니다. 어쨌든, 실제 FPGA에 코드를로드하고 실행하고 싶지는 않습니다. 그 목표를 달성하는 데 사용할 수있는 소프트웨어가 있습니까?
    fpga emulation altera 2016-12-25

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    Quartus에서 여러 Verilog 파일을 사용하는 방법

    저는 Altera (현재는 Intel) Quartus Prime 개발 및 DE0_Nano Cyclone IV 개발 보드를 사용하여 Verilog를 배우고 있습니다. Verilog 모듈 수준에서 매우 잘 보이는 Charles Roth 외 도서 "Verilog를 사용한 디지털 시스템 디자인"을 가지고 있습니다. 나는 또한 온라인 자습서의 숫자를 통해 봤고, 프
    verilog fpga quartus 2017-01-05

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    암호화 응용 프로그램에서 IV로 사용하기 위해 FPGA에서 난수를 생성하는 방법

    암호화 응용 프로그램 용 IV로 사용하기 위해 FPGA에서 난수를 생성하는 방법을 찾고 있습니다. 그러나, Stackoverflow에서 찾은 유사한 질문에 대한 답변은 지금까지 "암호화 된 SEED"에서 암호화 응용 프로그램에 적합하지 않은 임의의 숫자를 생성합니다. 다음과 같은 답변 2 포인터는 다음과 같습니다 - Random number generati
    random cryptography initialization fpga lfsr 2017-01-06

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    내부 발진기를 사용하여 시계를 VHDL로 설정할 수 있습니까?

    VHDL을 배우려고합니다. 직렬 데이터를위한 간단한 송신기를 작성하고 있습니다. 그러나, 나는 문제가 발생하여 - 내가 그것을 실행하기 위해 시계를해야하고, 내 FPGA (MAX II)에 대한 데이터 시트이 말한다 : MAX II 디바이스의 내부 오실레이터의 출력 : 3.3-5.5 MHz의 을 따라서 내부 FPGA 발진기의 주파수를 안정적으로 설정할 방법이
    vhdl fpga 2017-01-08

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    동일한 Verilog 또는 VHDL 코드가 다른 FPGA 보드에서 작동 할 수 있습니까?

    저는 FPGA를 처음 사용하기 때문에 한 가지를 이해해야합니다. mcu에서 코드는 하드웨어와 관련이 있어야하며 arduino에서는 raspberry pi 코드를 사용할 수 없습니다. 그러나 FPGA 칩 Verilog 또는 VHDL 코드를보고 이후 우리가 설계 한 회로를 만듭니다, 충분한 vhdl 또는 Verilog 코드를 다른 FPGA 보드 (사용할 수있는
    fpga 2017-01-15

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    신호가 VHDL에서 정수 값으로 초기화 할 수 없습니다.

    다음 코드에서 정수 값 1로 cipher_temp2를 초기화했습니다. 그러나 코드를 시뮬레이트 할 때 cipher_temp2의 값이 0 대신 초기화됩니다. 나는 내가 어디로 잘못되었는지 알아낼 수 없다. library IEEE; use IEEE.STD_LOGIC_1164.ALL; entity ciphercalculation is Port (M
    vhdl fpga 2017-01-16

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    Basys3 보드의 USB 포트에 데이터 입/출력

    Basys3 FPGA 보드의 USB 포트에서 데이터를 출력하거나 입력 할 수 있도록 VHDL 코드를 구성/작성하려고합니다. 문제는이 주제에 대해 이야기하는 스레드 또는 질문을 아직 찾지 못한 것입니다. 내가 찾은 답에 가장 가까운 것은 이것이다 : Provide input data to FPGA using USB 을 그리고 내가 무엇을 찾고 있어요 포함되어
    usb vhdl fpga 2017-01-17
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